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Design of a 10 bit quantizer for a 800 MHz/2 Gsps time-interleaving VCO-based A/D converter in 28nm CMOS technology
2018/2019 MUZI, RAFFAELLO
Design of a voltage regulator for a broad band ADC
2020/2021 BOULOS, SAMAR
Design of low-jitter multiphase clock and timing circuits for time-interleaved ADCs
2019/2020 Scaletti, Lorenzo
Linear voltage regulators for PLL in 28nm CMOS
2018/2019 ARMELI, WALTER
On-chip calibration of a 12-bit 1 GS/s time-interleaved ADC in 28nm CMOS
2019/2020 Be', Gabriele
| Fulltext | Data | Tipo | Titolo | Autore (i) |
|---|---|---|---|---|
| 2020-06-06 | Tesi di laurea Magistrale | Design of a 10 bit quantizer for a 800 MHz/2 Gsps time-interleaving VCO-based A/D converter in 28nm CMOS technology | MUZI, RAFFAELLO | |
| 2021-12-21 | Tesi di laurea Magistrale | Design of a voltage regulator for a broad band ADC | BOULOS, SAMAR | |
| 2020-10-02 | Tesi di laurea Magistrale | Design of low-jitter multiphase clock and timing circuits for time-interleaved ADCs | Scaletti, Lorenzo | |
| 2019-07-25 | Tesi di laurea Magistrale | Linear voltage regulators for PLL in 28nm CMOS | ARMELI, WALTER | |
| 2020-12-15 | Tesi di laurea Magistrale | On-chip calibration of a 12-bit 1 GS/s time-interleaved ADC in 28nm CMOS | Be', Gabriele |
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