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POLITesi - Archivio digitale delle tesi di laurea e di dottorato

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2019-10-03 Tesi di laurea Magistrale Progetto di blocchi abilitanti per PLL a 14 GHz con jitter minore di 100 fs in CMOS 28 nm TORELLI, LUCIANO
2019-04-16 Tesi di laurea Magistrale Progetto di oscillatore a controllo digitale a 20 GHz per wireless backhaul 5G DAGO, ALESSANDRO
2019-10-03 Tesi di laurea Magistrale Progetto di PLL accoppiati a 20 GHz in tecnologia CMOS 55nm TESOLIN, FRANCESCO
2011-12-20 Tesi di laurea Magistrale Progetto di un 10-bit DAC a 2.5 GS/s con circuito DDS per il test della linearità in CMOS 32 nm MARINO, EDOARDO
2011-12-20 Tesi di laurea Magistrale Progetto di un amplificatore di potenza RF in classe D per trasmettitori polari in tecnologia CMOS 65nm MARUCCI, GIOVANNI
2019-10-03 Tesi di laurea Magistrale Progetto di un digitally-modulated power amplifier per applicazioni IoT in tecnologia CMOS a 28nm PELOSINI, ALESSANDRO
2016-09-28 Tesi di laurea Magistrale Progetto di un PLL digitale a 3.6 GHz con controllo adattativo della banda per applicazioni radiomobili cellulari MERCANDELLI, MARIO
2016-07-28 Tesi di laurea Magistrale Progetto di un sintetizzatore di frequenza digitale a 3.6 GHz per applicazioni radiomobili con sistema di cancellazione automatica di spurie DEL BIANCO, ILARIA
2021-07-23 Tesi di laurea Magistrale Progetto di un trasmettitore sonar a 300 kHz per esplorazione di fondali marini, sminamento e ricerca scientifica Di Fabio, Samuele
2017-12-21 Tesi di laurea Magistrale Regolatori LDO per circuiti a radiofrequenza a basso rumore in CMOS 65 nm FRANCALANCI, TOMMASO
2016-09-28 Tesi di laurea Magistrale Sintesi di frequenza ad alta efficienza per applicazioni IOT SANTICCIOLI, ALESSIO; BONOMI, STEFANO
2014-12-18 Tesi di laurea Magistrale Studio dell'injection locking in sottoarmonica di oscillatori LC SEGRETO, DANIELE
2022-10-06 Tesi di laurea Magistrale Sviluppo di una filtenna stampabile su PCB low cost ad alto fattore di qualità ed elevato FoV per la banda ISM 24GHz Mori, Lorenzo
2014-03-07 Tesi di Dottorato Techniques for high speed and low power digital to analog converters FENAROLI, ANDREA
2020-02-03 Tesi di Dottorato Techniques for low-jitter and low-area occupation fractional-N Frequency synthesis MERCANDELLI, MARIO
2018-04-19 Tesi di laurea Magistrale Techniques to reduce the power consumption of a CMOS digital PLL for wireless systems MARTÍ PASCUAL, DAVID
2016-12-21 Tesi di laurea Magistrale Tecnica di analisi spettrale di un PLL basata su macro-modelli tempo-varianti parametrici LEONCINI, MAURO
2014-04-29 Tesi di laurea Magistrale Tecniche di mitigazione delle spurie in un PLL con oscillatore injection-locked a 1.6 GHz in CMOS 65 nm MAZZUCCHELLI, SIMONE
2022-01-25 Tesi di Dottorato Time-based controller for DCDC boost converter with right-half-plane zero mitigation LEONCINI, MAURO
2019-07-25 Tesi di laurea Magistrale Time-based-compensation method for a DC-DC boost converter GEORGIEVSKI, GORJAN
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